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Générateurs d'horloge pour processeurs SOC : circuits et architectures par Amr Fahim (En

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ISBN-13: 9781441954701

Book Title: Clock Generators for SOC Processors

ISBN: 9781441954701

Subject Area: Technology & Engineering

Publication Name: Clock Generators for SOC Processors : Circuits and Architectures

Item Length: 9.3 in

Publisher: Springer

Subject: Electronics / Circuits / General, Electrical

Publication Year: 2010

Type: Textbook

Format: Trade Paperback

Language: English

Author: Amr Fahim

Item Width: 6.1 in

Item Weight: 16 Oz

Number of Pages: Xviii, 246 Pages

À propos de ce produit

Product Information

This book explores the design of fully-integrated frequency synthesizers suitable for system-on-a-chip (SOC) processors. The text takes a more global design perspective in jointly examining the design space at the circuit level as well as at the architectural level. The comprehensive coverage includes summary chapters on circuit theory as well as feedback control theory relevant to the operation of phase locked loops (PLLs). On the circuit level, the discussion includes low-voltage analog design in deep submicron digital CMOS processes, effects of supply noise, substrate noise, as well device noise. On the architectural level, the discussion includes PLL analysis using continuous-time as well as discrete-time models, linear and nonlinear effects of PLL performance, and detailed analysis of locking behavior. The book provides numerous real world applications, as well as practical rules-of-thumb for modern designers to use at the system, architectural, as well as the circuit level.

Product Identifiers

Publisher

Springer

ISBN-10

1441954708

ISBN-13

9781441954701

eBay Product ID (ePID)

109117781

Product Key Features

Author

Amr Fahim

Publication Name

Clock Generators for SOC Processors : Circuits and Architectures

Format

Trade Paperback

Language

English

Subject

Electronics / Circuits / General, Electrical

Publication Year

2010

Type

Textbook

Subject Area

Technology & Engineering

Number of Pages

Xviii, 246 Pages

Dimensions

Item Length

9.3 in

Item Width

6.1 in

Item Weight

16 Oz

Additional Product Features

Intended Audience

Scholarly & Professional

Number of Volumes

1 Vol.

Lc Classification Number

Tk7867-7867.5

Table of Content

Phase-Locked Loop Fundamentals.- Low-Voltage Analog Cmos Design.- Jitter Analysis in Phase-Locked Loops.- Low-Jitter PLL Architectures.- Digital PLL Design.- DSP Clock Generator Architectures.- Design for Testability in PLLs.- Clock Partitioning and Skew Control.

2005

Dewey Decimal

621.3815486

Dewey Edition

Illustrated

Yes

Description de l'objet du vendeur

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